Datenblatt-Suchmaschine für elektronische Bauteile |
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TMP320C6413ZTS400 Datenblatt(PDF) 6 Page - Texas Instruments |
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TMP320C6413ZTS400 Datenblatt(HTML) 6 Page - Texas Instruments |
6 / 140 page Figures 6 April 2004 − Revised May 2005 SPRS247E List of Figures Figure Page 2−1 GTS and ZTS BGA Packages (Bottom View) 12 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−2 Functional Block Diagram 15 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−3 TMS320C64xE CPU (DSP Core) Data Paths 18 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−4 TMS320C6413 L2 Architecture Memory Configuration 21 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−5 TMS320C6410 L2 Architecture Memory Configuration 22 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−6 CPU and Peripheral Signals 39 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−7 Peripheral Signals 40 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−1 Peripheral Configuration Register (PERCFG) [Address Location: 0x01B3F000] 46 . . . . . . . . . . . . . . . . . . 3−2 Peripheral Enable/Disable Flow Diagram 48 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−3 PCFGLOCK Register Diagram [Address Location: 0x01B3 F018] − Read/Write Accesses 49 . . . . . . . . 3−4 Device Status Register (DEVSTAT) Description − 0x01B3 F004 50 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−5 JTAG ID Register Description − TMS320C6413/C6410 Register Value − 0x0007 902F 51 . . . . . . . . . . . . 3−6 Configuration Example A (HPI16 + 2 McASPs + 2 McBSPs +2 I2Cs + EMIF + 3 Timers + GPIO) 54 . . . . . . . . . . . . . . . . . . . . . . . . 3−7 TMS320C6413/C6410 DSP Device Nomenclature 69 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−1 External PLL Circuitry for Either PLL Multiply Modes or x1 (Bypass) Mode 72 . . . . . . . . . . . . . . . . . . . . . . 4−2 McASP0 and McASP1 Configuration 77 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−3 I2Cx Module Block Diagram 79 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−4 GPIO Enable Register (GPEN) [Hex Address: 01B0 0000] 80 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−5 GPIO Direction Register (GPDIR) [Hex Address: 01B0 0004] 81 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−6 Power-Down Mode Logic† 82 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−7 PWRD Field of the CSR Register 83 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−8 Schottky Diode Diagram 85 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6−1 Test Load Circuit for AC Timing Measurements 91 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6−2 Input and Output Voltage Reference Levels for AC Timing Measurements 91 . . . . . . . . . . . . . . . . . . . . . . 6−3 Rise and Fall Transition Time Voltage Reference Levels 91 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6−4 Board-Level Input/Output Timings 92 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−1 CLKIN Timing 93 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−2 CLKOUT4 Timing 94 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−3 CLKOUT6 Timing 94 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−4 AECLKIN Timing for EMIFA 95 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−5 AECLKOUT1 Timing for the EMIFA Module 95 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−6 AECLKOUT2 Timing for the EMIFA Module 96 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−7 Asynchronous Memory Read Timing for EMIFA 98 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−8 Asynchronous Memory Write Timing for EMIFA 99 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . |
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